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Title of test:
Eletrônica Digital 2

Description:
Eletrônica geral

Author:
AVATAR

Creation Date:
12/04/2019

Category:
Others

Number of questions: 41
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Content:
O parâmetro VIH corresponde a: Tensão de saída correspondente ao nível lógico baixo Tensão de saída correspondente ao nível lógico alto Tensão de entrada correspondente ao nível lógico alto Tensão de entrada correspondente ao nível lógico baixo.
O parâmetro IOL corresponde a: Corrente de entrada correspondente ao nível lógico alto Corrente de entrada correspondente ao nível lógico baixo Corrente de saída correspondente ao nível lógico alto Corrente de saída correspondente ao nível lógico baixo.
O número máximo de portas lógicas que podem ser ligadas à saída de outra porta da mesma família é chamado de: Potência de consumo Tempo de atraso de propagação Fan-in Fan-out.
Qual a definição para tempo de atraso de propagação? Imunidade ao ruído Fan Out É o tempo que demora entre o instante que aplicamos um nível lógico na entrada e o instante em que btemos a resposta na saída VIH.
Como se chama a capacidade de tolerância a ruídos de uma família lógica sem alteração dos seus níveis lógicos? Imunidade ao ruído Fan Out VOH VIL.
Duas das características mais importantes das famílias de circuitos lógicos são a sua velocidade de operação e a potência consumida, sendo que o ideal é: alta velocidade de operação e baixa potência dissipada baixa velocidade de operação e alta potência dissipada alta velocidade de operação e alta potência dissipada baixa velocidade de operação e baixa potência dissipada.
As famílias lógicas diferem basicamente pelo componente principal utilizado em seus circuitos, sendo atualmente mais usadas as famílias: RTL e TTL TTL e CMOS DTL e CMOS RTL e CMOS.
Qual o principal componente utilizado na fabricação da família lógica TTL? TJB (Transistor de Junção Bipolar) Mosfet (Transistor de Efeito de Campo) SCR DIAC.
A figura abaixo mostra as faixas de tensão correspondentes aos níveis lógicos de entrada de um circuito integrado da família TTL Standard. Essa família não reconhece os níveis lógicos 0 e 1 na faixa de valores entre: 2V e 5V 0,8V e 2V 0V e 0,8V 0V e 5V.
Considerando o produto velocidade-potência, qual a melhor série da família TTL? TTL 74 ALS 74 C 4000 AL 74 AL.
Qual o principal componente utilizado na fabricação da família lógica CMOS? Mosfet (Transistor de Efeito de Campo) TRIAC TJB DIAC.
O perigo maior do manuseio dos circuitos integrados CMOS se deve a: Descargas eletroestáticas Aquecimento da pastilha semicondutora Perigo de quebra dos terminais Contaminação radioativa.
De maneira geral, a família CMOS apresenta VILmáx e VIHmín iguais a: 10% e 50% da sua tensão de alimentação 40% e 80% da sua tensão de alimentação 20% e 60% da sua tensão de alimentação 30% e 70% da sua tensão de alimentação.
Essa série CMOS foi desenvolvida para ser compatível em termos de tensões com dispositivos da família TTL, podendo ser alimentada diretamente pelas saídas desses dispositivos: 74HCT 74HC 4000B 74C.
Quais os três possíveis estados de saída de um circuito tri-state? 0 e 1 0 e 0 0, 1 e alta impedância 0, 1 e clear.
O que é um Buffer? É um circuito que coloca os dados de sua entrada em sua saída sem alterar o nível lógico do sinal. Alto falante Um TJB Um SCR.
Complete os espaços em branco: Os circuitos ____________________ apresentam as suas saídas, única e exclusivamente, dependentes das variáveis de entrada. Já os circuitos _____________________ têm as suas saídas dependentes das variáveis de entrada e de seus estados anteriores que permanecem armazenados. combinacionais, sequenciais sequenciais, combinacionais integrados, sequenciais combinacionais, integrados.
Os flip-flops são dispositivos biestáveis porque possuem em sua saída: dois estados instáveis apenas um estado estável dois estados estáveis um número indeterminado de estado estáveis.
Um flip-flop pode armazenar em sua saída: meio byte 1 bit 1 byte 2 bits.
Um flip-flop RS resetado apresenta os seguintes níveis lógicos em suas saídas: Q = 1 e Q’ = 1 Q = 0 e Q’ = 1 Q = 1 e Q’ = 0 Q = 0 e Q’ = 0.
Um flip-flop RS setado apresenta os seguintes níveis lógicos em suas saídas: Q = 1 e Q’ = 1 Q = 0 e Q’ = 1 Q = 1 e Q’ = 0 Q = 0 e Q’ = 0.
No flip-flop RS, quando as entradas R e S são ativadas simultaneamente: ocorre um erro lógico a saída permanece inalterada a saída é resetada a saída é setada.
Complete os espaços em branco: Os flip-flops podem ter uma entrada denominada __________ que, através de um sinal externo, determina o momento da atualização das saídas Q e Q . Clock Clear Preset Enable.
Por que foi criado o flip-flop JK? Para resolver o problema do erro lógico no flip-flop RS Para revolucionar a indústria Para obter dos níveis lógicos nas saídas Para solucionar o problema dos contadores síncronos.
No flip-flop JK disparado pela borda de descida, as saídas são atualizadas somente quando: o pulso de clock vai do nível baixo para o nível alto o pulso de clock permanece no nível baixo o pulso de clock vai do nível alto para o nível baixo o pulso de clock permanece no nível alto.
Que entradas do flip-flop são consideradas assíncronas, isto é, podem alterar o valor da saída independente da entrada de clock? Preset e Clear R e S J e K T e D.
Complete os espaços em branco: Quando queremos que a saída Q de um flip-flop vá para nível lógico 1, mesmo que o clock esteja desativado, devemos ativar a entrada ____________. Preset Clear Set Reset.
Complete os espaços em branco: Quando queremos que a saída Q de um flip-flop vá para nível lógico 0, mesmo que o clock esteja desativado, devemos ativar a entrada ____________. Enable Reset Preset Clear.
Ligando as entradas do flip-flop JK como mostrado abaixo, é possível construir um flip-flop: T (Toggle) RS D (Data) Preset.
Ligando as entradas do flip-flop JK como mostrado abaixo, é possível construir um flip-flop: RS T (Toggle) D (Data) Preset.
Cite aplicações para o flip-flop D: Shift-Register (Registrador de Deslocamento) e em sistemas de memória Contadores Contadores síncronos Outros.
Cite aplicações para o flip-flop T: Contadores assíncronos e divisores de frequência Registradores Outros Shift-Register.
O que é um circuito registrador? Um registrador é um conjunto de células de memória arranjadas como um único dispositivo capaz de armazenar uma quantidade maior de bits. É um dispositivo que pode modificar o conteúdo dos dados, deslocando-os para a direita ou para a esquerda.
O que é um registrador de deslocamento (SHIFT REGISTER)? Um registrador é um conjunto de células de memória arranjadas como um único dispositivo capaz de armazenar uma quantidade maior de bits. É um dispositivo que pode modificar o conteúdo dos dados, deslocando-os para a direita ou para a esquerda.
A forma básica padrão de construção de um registrador de deslocamento utiliza que tipo de flip-flop? Tipo D, ligado em cascata. Tipo T, ligado em cascata. JK, ligado em cascata.
Complete os espaços em branco: Os registradores podem ter quatro tipos diferentes de configuração, de acordo como os dados são transferidos. No modo ____________ os dados são recebidos (ou transmitidos) bit a bit, em uma única linha. Já no modo ____________ todos os bits são recebidos (ou transmitidos) simultaneamente, sendo o número de linhas igual ao número de bits da informação. Serial, Paralelo. Paralelo, Serial. Cascata, Serial. Paralelo, Cascata.
No registrador de deslocamento abaixo, a entrada é aplicada em E e retirada em Q3, Q2, Q1 e Q0. Esse Registrador é do tipo: ES/SS EP/SS ES/SP EP/SP.
Para converter uma informação paralela em série devemos usar o registrador de deslocamento do tipo: EP/SS ES/SS ES/SP EP/SP.
O registrador do tipo Shift-Right pode ser utilizado para realizar que operação aritmética em binário? divisão por 2 Subtração soma multiplicação por 2.
O registrador do tipo Shift-Left pode ser utilizado para realizar que operação aritmética em binário? soma Subtração multiplicação por 2 divisão por 2.
O registrador abaixo é do tipo Shift-Right. Sabendo que inicialmente Q3=0, Q2=1, Q1=0 e Q0=0, qual será o novo valor de Q3, Q2, Q1 e Q0 após um pulso de clock se mantivermos nível zero na entrada série do registrador? Q3 = 0, Q2 = 1, Q1 = 0, Q0 = 0 d) Q3 = 1, Q2 = 0, Q1 = 0, Q0 = 0 Q3 = 0, Q2 = 0, Q1 = 0, Q0 = 1 Q3 = 0, Q2 = 0, Q1 = 1, Q0 = 0.
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